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Modeling RISC-V Processor in IP-XACT
2018
IP-XACT is the most used standard in IP (Intellectual Property) integration. It is intended as a language neutral golden reference, from which RTL and HW dependent SW is automatically generated. Despite its wide popularity in the industry, there are practically no public and open design examples for any part of the design flow from IP-XACT to synthesis. One reason is the difficulty of creating IP-XACT models for existing RTL projects. In this paper, we address the issues by modeling the PULPino RISC-V microprocessor that is written in SystemVerilog (SV) and the project distributed over several repositories. We propose how to solve the mismatching concepts between SV project and IP-XACT, and…
Open design. Pratiche di progetto e processi di conoscenza
2013
In un momento caratterizzato da una profonda crisi di sistema, che investe l’economia e gli assetti produttivi ma anche identità e valori, si moltiplicano le riflessioni e le posizioni che indicano nel ritorno ad una rinnovata dimensione del fare una via possibile per riavviare processi economici innovativi, che ridiano centralità alle persone e alle comunità. Recuperare il “saper fare” artigianale, al tempo dell’intelligenza collettiva e connettiva, dell’internet delle cose, dell’open source e dei fablab, può essere occasione di rinascita economica e sociale, individuale e collettiva, di più generazioni di progettisti e innovatori, minacciati negli ultimi anni dallo “spettro dell’inutilità…